一、減小來自電源的噪聲

電源在向系統提供能源的同時，也將其噪聲加到所供電的電源上。

電路中微控制器的復位線，中斷線，

以及其它一些控制線容易受外界噪聲的干擾。

電網上的強干擾通過電源進入電路。

即使電池供電的系統，電池本身也有高頻噪聲。

模擬電路中的模擬信號更經受不住來自電源的干擾。因此設計電源時要采取一定的抗干擾措施：(如輸入電源與強電設備動力線分開;采用隔離變壓器;采用低通濾波器;采用獨立功能塊單獨供電等)。

二、減小信號傳輸中的畸變

微控制器主要采用高速CMOS技術制造。信號輸入端靜態輸入電流在1mA左右，輸入電容10pF左右，輸入阻抗相當高。高速CMOS電路的輸出端都有相當的帶載能力，即相當大的輸出值，將一個門的輸出端通過一段很長線引到輸入阻抗相當高的輸入端，反射問題就很嚴重。它會引起信號畸變，增加系統噪聲。當Tpd>Tr時，就成了一個傳輸線問題，必須考慮信號反射、阻抗匹配等問題。

信號在印制板上的延遲時間與引線的特性阻抗有關，即與印制線路板材料的介電常數有關。可以粗略地認為，信號在印制板引線的傳輸速度，約為光速的1/3到1/2之間。微控制器構成的系統中常用邏輯電子元件的Tr(標準延遲時間)為3到18ns之間。

在印制線路板上，信號通過一個7W的電阻和一段25cm長的引線，線上延遲時間大致在4～20ns之間。也就是說，信號在印刷線路上的引線越短越好，長不宜超過25cm。而且過孔數目也應盡量少，好不多于2個。

當信號的上升時間快于信號延遲時間，就要按照快電子學處理。此時要考慮傳輸線的阻抗匹配，對于一塊印刷線路板上的集成塊之間的信號傳輸，要避免出現Td>Trd的情況，

印刷線路板越大系統的速度就越不能太快。

 

 

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